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Verilog HDL 的基本知識與常用語法

課程數: 5 課時|學習人數:334人

專輯簡介

本教程主要介紹了Verilog HDL 基本語法

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          本教程主要介紹了Verilog HDL 基本語法、常用的Verilogy語法:模塊的結構、數據類型、運算符與表達式、賦值語句和塊語句、條件語句、循環語句、生成語句、結構說明、任務和函數說明語句、常用的系統任務、調試用的系統任務、常用編譯預處理語句等知識

講師介紹
  • 周立功單片機

    講師 /周立功先生于1999年創立廣州周立功公司,憑借10余年的專注和努力,擁有北京、上海、南京、杭州、深圳、成都、重慶、武漢、香港等9家分公司,銷售工程師、市場工程師和技術支持工程師200多人,產品研發工程師400多人,代理銷售產品從傳統的單片機,發展為ARM7/ARM9、Cortex-M0/Cortex-M3、FPGA、DSP、汽車電子、智能識別、電源器件、模擬器件、存儲器件等整套微控制器。。

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